Differences
This shows you the differences between two versions of the page.
|
soc:sidebar [2026/03/11 20:43] dan.tudose |
soc:sidebar [2026/04/01 13:11] (current) andrei.darlau lab5 public |
||
|---|---|---|---|
| Line 29: | Line 29: | ||
| * [[soc:laboratoare:01 | 01 - Introducere în Verilog]] | * [[soc:laboratoare:01 | 01 - Introducere în Verilog]] | ||
| * [[soc:laboratoare:02 | 02 - Tipuri de descriere a modulelor în Verilog]] | * [[soc:laboratoare:02 | 02 - Tipuri de descriere a modulelor în Verilog]] | ||
| - | <hidden> | ||
| - | * [[soc:laboratoare:xx | XX - Model laborator]] | ||
| * [[soc:laboratoare:03 | 03 - FPGA & Debugging]] | * [[soc:laboratoare:03 | 03 - FPGA & Debugging]] | ||
| * [[soc:laboratoare:04 | 04 - Automate cu stări]] | * [[soc:laboratoare:04 | 04 - Automate cu stări]] | ||
| * [[soc:laboratoare:05 | 05 - Afișajul cu 7 segmente]] | * [[soc:laboratoare:05 | 05 - Afișajul cu 7 segmente]] | ||
| + | <hidden> | ||
| + | * [[soc:laboratoare:xx | XX - Model laborator]] | ||
| * [[soc:laboratoare:06 | 06 - Sumatoare]] | * [[soc:laboratoare:06 | 06 - Sumatoare]] | ||
| * [[soc:laboratoare:07 | 07 - Sumatorul CLA]] | * [[soc:laboratoare:07 | 07 - Sumatorul CLA]] | ||
